Verilog-2001 之 generate 语句的用法

win_hshiw · 发表于 2012-12-14 20:51:20

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Verilog generate语句的用法.pdf (237.6 KB , 下载次数: 140 ) 这是我本人总结出来的generate 语句的用法，结构清晰，个人觉得新添加的语句中，generate 语句还是挺有用途的。

ll28 · 发表于 2012-12-15 22:08:20

总结的不错，下载看看。

zhangrenzhe001 · 发表于 2013-6-6 16:50:52

XIEXIE

zhangrenzhe001 · 发表于 2013-6-6 16:52:25

XUEXIZHONG

上善若水622 · 发表于 2014-6-24 11:07:48

谢谢！

285940684 · 发表于 2016-6-26 21:29:18

谢谢分享

wuketom · 发表于 2019-9-20 14:03:54

很好的总结

jcchan · 发表于 2019-9-20 15:08:35

总结的不错，下载看看。

smzh0531 · 发表于 2021-7-28 14:53:42

学习

durbin · 发表于 2021-7-29 08:46:12

GOOD!

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[资料] Verilog-2001 之 generate 语句的用法