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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › Analog/RF IC 设计 › Analog/RF IC 资料共享 › 《Verilog HDL黄金指南》中文翻译版
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楼主: louwf

《Verilog HDL黄金指南》中文翻译版

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yunkuan
发表于 2007-2-14 11:18:49 | 显示全部楼层
thank you
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yunkuan
发表于 2007-2-14 11:21:17 | 显示全部楼层
thank you
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framing
发表于 2007-4-18 22:58:04 | 显示全部楼层
喜欢中文版
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yangfunc
发表于 2007-4-19 21:15:07 | 显示全部楼层
ddddddddddddddd
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sjxu007
发表于 2007-4-20 12:22:10 | 显示全部楼层
好吧！！！！
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iyahsue
发表于 2008-5-16 11:00:05 | 显示全部楼层
gooooooooooooooooood
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ahshima
发表于 2008-9-18 15:37:23 | 显示全部楼层
thanks
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ahshima
发表于 2008-9-18 15:40:02 | 显示全部楼层
还是中文版看起来方便
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ahshima
发表于 2008-9-18 15:42:50 | 显示全部楼层
很好的资料,谢谢了.
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gatezte2008
发表于 2008-9-19 08:51:47 | 显示全部楼层
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