verilog 多线程 multi thread

taku2006 · 发表于 2012-11-22 22:38:51

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verilog仿真的时候能实现多线程么，是需要在verilog代码里面控制还是使用多线程的仿真器。现在实验室的服务器平台，cpu核很多，但是主频偏低，目前仿真只能用到一个核，实在是慢死了，要是能用上多线程就能解决速度慢的问题了。

zeushuang · 发表于 2012-12-12 14:29:03

需要多线程的仿真器的支持！

asin28 · 发表于 2012-12-17 22:44:10

ISE好像不能设置多线程仿真吧？

求教。

taku2006 · 发表于 2013-2-28 19:45:48

回复 3# asin28

呵呵，我不是说ISE平台，是用的cadence，后面问了cadence的工程师，说综合可以多线程，仿真不可以

ibubapa · 发表于 2018-3-23 22:42:55

thanks for sharing

dennis77924 · 发表于 2018-3-24 15:28:10

thanks for sharing

glingsong · 发表于 2018-3-24 21:24:58

vcs仿真器支持多CPU核仿真，但实际上仿真性能提升有限。

glace12123 · 发表于 2018-3-27 22:19:20

和verilog有什么关系，那是仿真软件的事情

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