能不能尝试用system verilog对处理器写个测试平台呢？让大家学习学习

DJliubojun · 发表于 2012-12-24 21:45:11

还不清楚system verilog和verilog有何区别，目前只认识verilog

guolehaohao · 发表于 2013-8-22 16:34:48

henhao，xuexile

waltjung · 发表于 2013-10-17 13:38:08

回复 2# sherry_001
sherry_001,看到你已经用UVM搭好了测试平台,非常的激动.刚开始关注这个opensource的 ARM. 也有同样的想法, 望方便时指教.

vlsi1217 · 发表于 2013-12-10 22:55:25

可以分享一下搭好的平台吗？

_shanks · 发表于 2016-6-30 10:25:41

回复 2# sherry_001

有没有脚本之类的分享下。现在用UVM调用matlab .

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