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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › Analog/RF IC 设计 › Analog/RF IC 设计讨论 › 关于cadence ADE 仿真器收敛性的问题 谢谢
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查看: 3388|回复: 3

[原创] 关于cadence ADE 仿真器收敛性的问题 谢谢

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mcafee
发表于 2012-10-16 14:42:15 | 显示全部楼层 |阅读模式

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大虾你好，小弟在此有礼了，最近跑ADE仿真的时候，老是遇到一个关于收敛性的问题，如图所示，我知道这个玩意可以通过设置步进来解决，问题是，我不知道从哪里设置，设置什么项目？  麻烦大虾指导一下，谢谢！  辛苦了！
如图所示, 收敛, 我不知道
Snap_2012.10.16_14h40m00s_001.png

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youngs
发表于 2012-10-17 18:00:44 | 显示全部楼层
你确定你可以通过设置步进来解决？

好像是仿tran的option里面有选项可以选择仿真最小步长  不知道是不是你想要的

我之前遇到了是因为有floating的节点，部分电路节点悬空。
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发表于 2012-10-18 14:42:03 | 显示全部楼层
一般是有电感或者电路没有设置 gnd ，结果跑飞了。
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fj198462
发表于 2020-4-5 23:23:24 | 显示全部楼层
谢谢分享！
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