DC和PT

XIDIANCAD2 · 发表于 2012-10-15 17:53:29

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DC和PT用的库文件和时序分析环境以及设计约束条件都是一样的，为什么设计在DC的静态时序分析和在PT的静态时序分析的结果显示同一条路径INV的延时却不样，而且建立时间的大小也不样。用的是同一个库建立时间居然不一样？希望大家帮我解答下。

364366191 · 发表于 2012-10-16 23:08:40

你的margin设的一样？DC的时候不是有margin啊？PT的时候你也留有余量？

陈涛 · 发表于 2012-10-17 13:06:41

首先我怀疑这3个一样，“DC和PT用的库文件和时序分析环境以及设计约束条件都是一样的”
PT有些设定DC里面没有，而PT的那些默认设定与DC有可能就不一样

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