在线咨询
eetop公众号 创芯大讲堂 创芯人才网
切换到宽版

EETOP 创芯网论坛 (原名:电子顶级开发网)

手机号码,快捷登录

手机号码,快捷登录

找回密码

  登录   注册  

快捷导航
搜帖子
查看: 2648|回复: 4

[求助] Full Custom Digital Design的APR问题【已解答】

[复制链接]
发表于 2012-8-4 13:14:35 | 显示全部楼层 |阅读模式

马上注册,结交更多好友,享用更多功能,让你轻松玩转社区。

您需要 登录 才可以下载或查看,没有账号?注册

x
本帖最后由 alphavor_jay 于 2012-8-4 21:30 编辑

公司新的设计要用自己开发的工艺,所以数字部分需要在foundry提供的工艺基础上自己再做一些修改。今天看Laker的资料的时候,发现Laker OA2011.03可以做数字标准单元的设计和整个电路的APR,不知道Cadence里面是不是也有相应的功能还是要借助其他的外部工具呢?小弟菜鸟,谢谢各位大哈~
还有一些在做数字全定制设计中的问题,比如自己画的标准单元,怎么来做形式验证和静态时序分析呢?
发表于 2012-8-4 17:00:34 | 显示全部楼层
laker的那个功能主要针对analog设计里面的小规模数字模块,想做大的APR的话,等synopsys把它和ICC连在一起吧

自己画的标准单元,可以按照fundary的标准流程走,画好后,建库,再做APR。
形式验证和静态时序分析也是分2步走,
layout 对 建好的库负责
APR只用库里面的信息做LEC和STA
 楼主| 发表于 2012-8-4 21:29:18 | 显示全部楼层
回复 2# 陈涛


   谢谢涛大的解答哈~
发表于 2014-9-13 21:05:57 | 显示全部楼层
发表于 2014-9-14 15:00:45 | 显示全部楼层
laker,virtuoso的APR很弱的,否则icc, encounter 卖不动了,
只是版图级别的 稍微自动化一些的apr,和gate level apr有很大区别,
您需要登录后才可以回帖 登录 | 注册

本版积分规则

关闭

站长推荐 上一条 /2 下一条


小黑屋| 手机版| 关于我们| 联系我们| 在线咨询| 隐私声明| EETOP 创芯网
( 京ICP备:10050787号 京公网安备:11010502037710 )

GMT+8, 2024-12-23 02:23 , Processed in 0.021020 second(s), 8 queries , Gzip On, Redis On.

eetop公众号 创芯大讲堂 创芯人才网
快速回复 返回顶部 返回列表