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查看: 5512|回复: 11

[求助] 后仿出问题怎么解决

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发表于 2012-7-31 17:30:27 | 显示全部楼层 |阅读模式

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Warning!  Timing violation
           $setuphold<hold>( negedge CKN &&& (flag == 1):77893 NS, negedge D:77893 NS,  1.000 : 1 NS,  0.500 : 500 PS );
            File: ./Verilog/smic18_neg.v, line = 7094
           Scope: cal_TOP_t_TB.U_CAL_TOP.U_cal_ADC.code_t_3b_r_reg_2
            Time: 77893 NS
很多这样的报告,不知道怎么解决,大侠们帮帮我这个可怜的初学者吧,好像没有反标上但是不知道怎么解决。
发表于 2012-7-31 19:50:11 | 显示全部楼层
真的没有反标上,先检查看见表与SDF文件是不是一致的
我现在后仿也遇到问题了,卡着了
发表于 2012-7-31 23:33:01 | 显示全部楼层
观察波形,一般这些都是没有满足建立保持时间所致的告警错误,看看不定态出现的时刻,然后看看是不是在报告中能够找到该时刻点,追根溯源,发现不定态产生的源头,再针对性地调整。
发表于 2012-7-31 23:33:17 | 显示全部楼层
需要修改SDF文件对应的部分
 楼主| 发表于 2012-8-1 08:25:58 | 显示全部楼层
回复 4# diyangguang


   谢谢,我试试哈
 楼主| 发表于 2012-8-1 11:28:16 | 显示全部楼层
回复 4# diyangguang


小声的问一问,该怎么去改正呢?
 楼主| 发表于 2012-8-1 11:32:08 | 显示全部楼层
回复 3# gaurson

是不是看sdf的报告?我的后仿报告除了哪个警告外没有东西啊
 楼主| 发表于 2012-8-1 14:34:33 | 显示全部楼层
回复 2# my2817

怎么检查网表和sdf是否对应上啊,我第一次做这个。
 楼主| 发表于 2012-8-1 14:54:20 | 显示全部楼层
会不会是lib文件的问题。我的lib文件是分开时序setup和hold。
发表于 2012-8-1 15:15:15 | 显示全部楼层
我来学习
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