COATAS数字锁相环FPGA实现问题--数据的截取

bzxylyz · 发表于 2012-7-2 16:38:17

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COATAS数字锁相环由鉴相器、环路滤波器和数字频率发生器组成，在使用FPGA实现是，随着各个模块对信号的处理，输出的数据位数也会增加。比如输入的数据位8位，经过环路滤波器（系数为8位）后，输出数据变长位16位。在COSTAS环的输出数据会比输入数据长很多，如何合理的截取输出数据，使之得到合适长度的数据呢？是在costas的输出端一次性截取还是在每个模块输出后进行合适的截取呢？？请告诉指教！！！

bzxylyz · 发表于 2012-7-2 16:39:31

求同行指教讨论

bzxylyz · 发表于 2012-7-9 09:55:02

额，求大牛指点哈

bzxylyz · 发表于 2012-7-27 09:34:52

有没有同行，请求援助哈。

bzxylyz · 发表于 2012-7-27 09:35:58

请求大牛指点哈

[求助] COATAS数字锁相环FPGA实现问题--数据的截取

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