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之前装过modelsim6.5, 完全可以用,就是在仿真systemverilog时,感觉不太给力,就下了个modelsim10,还有questasim10, 破解也按照网上说的破解了,软件也打开了,也可以使用,vlib,vlog这些命令来建库,编译,但是就是仿真的时候 总是显示一直 在 loading design,怎么都loading不成功,一个hello world而已,用6.5就可以,但是这两个新版本怎么搞都不行,求高手解决一下,是不是还需要做点什么啊? |
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