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查看: 5381|回复: 6

[求助] dc 综合后没有verilog文件生成 是怎么回事 求助大家

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发表于 2012-5-31 15:50:39 | 显示全部楼层 |阅读模式

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综合出现

error: unknown command ' change_names -rules verilog -hierarchy -verbose ' (CMD-005)

没有verilog文件生成

下面是脚本的输出部分:
set filebase [format "%s%s" [format "%s%s" $basename "_"] $runname]
# structural (synthesized) file as verilog                 
if {  $write_v == 1 } {
    set filename [format "%s%s" $filebase ".v"]
    redirect change_names \
{ change_names -rules verilog -hierarchy -verbose }
    write -format verilog -hierarchy -output $filename
}


其他的像.ddc, .rep文件等输出都没有问题
发表于 2012-5-31 22:45:49 | 显示全部楼层
直接
write -format verilog -hierarchy -output $filename
行不?
如果行的话是不是你 没有set write_v 1
 楼主| 发表于 2012-6-1 11:39:43 | 显示全部楼层
回复 2# my2817

注释掉
       redirect change_names \
{ change_names -rules verilog -hierarchy -verbose }
之后,是有verilog文件生成了

但是我之前有将 set write_v 1

不知道是不是上面的语句有问题?
 楼主| 发表于 2012-6-1 14:28:28 | 显示全部楼层
回复 2# my2817


          redirect change_names \
{ change_names -rules verilog -hierarchy -verbose }
好像是用来检查生成的verilog文件的句法的
发表于 2012-6-2 20:37:59 | 显示全部楼层
学习下
 楼主| 发表于 2012-6-4 15:33:02 | 显示全部楼层
自己顶一下
发表于 2012-7-28 13:43:30 | 显示全部楼层
卫生吗
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