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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › Analog Layout（版图） › Layout讨论区 › smic18 EEPROM 阵列lvs疑问
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楼主: huanggang870

[求助] smic18 EEPROM 阵列lvs疑问

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fucka03
发表于 2014-1-20 22:39:40 | 显示全部楼层
感谢楼主分享
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andy2000a
发表于 2014-1-24 21:40:44 | 显示全部楼层
EEPROM 是否算特殊 LOGIC PROCESS ?
因為 EEPROM 好像和 flash  block erase 不同
不知道 CELL LAYOUT 是長得如何 ?  SIMULATION 是如何 模擬?
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vincentlu
发表于 2014-2-3 13:55:40 | 显示全部楼层
怎么又是smic???
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ralphtw
发表于 2014-10-15 20:01:02 | 显示全部楼层
check lvs report !
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leshi
发表于 2014-10-16 10:28:18 | 显示全部楼层
calibre LVS里面有一选项可以屏蔽掉某个CELL
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发表于 2016-6-4 09:32:20 | 显示全部楼层
学习了
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