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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › 资源共享 › EDA资源使用讨论 › Verilog FSM自动生成script
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楼主: xiyue_007

Verilog FSM自动生成script

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发表于 2014-12-25 13:43:42 | 显示全部楼层
下载下来备用
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softzt
发表于 2015-1-22 15:37:35 | 显示全部楼层
谢谢分享
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发表于 2015-2-14 18:05:15 | 显示全部楼层
謝謝好東西 先頂一個
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发表于 2015-5-8 12:39:29 | 显示全部楼层
回复 1# xiyue_007


   要有python编写的就好了！谢谢咯！
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发表于 2015-12-24 18:27:39 | 显示全部楼层
回复 1# xiyue_007


   谢谢 分享哈哈哈哈
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giveup
发表于 2016-1-1 10:54:53 | 显示全部楼层
我喜欢懒人工具
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发表于 2018-8-29 15:24:47 | 显示全部楼层
不管怎样，下了再说
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发表于 2018-11-19 22:35:39 | 显示全部楼层
頂一個
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发表于 2018-11-20 02:25:59 | 显示全部楼层
good one thank you
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发表于 2019-1-29 21:18:07 | 显示全部楼层
谢谢分享。
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