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[原创] Three edition, Writing Testbench...

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发表于 2012-3-16 05:59:56 | 显示全部楼层 |阅读模式

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好的设计是test出来的!

Writing.Testbenches.Using.SystemVerilog.3rd.Edition.rar

1.66 MB, 下载次数: 274 , 下载积分: 资产 -2 信元, 下载支出 2 信元

发表于 2012-3-16 15:13:25 | 显示全部楼层
看看先
发表于 2012-3-19 10:23:45 | 显示全部楼层
see see
发表于 2012-3-23 21:56:23 | 显示全部楼层
第一版的啊,就觉得奇怪,二版都还没出,哪来的三版
发表于 2012-3-26 14:12:28 | 显示全部楼层
没注意看楼上的,确实只是第一版
发表于 2012-4-27 14:52:24 | 显示全部楼层
好的设计是设计出来的,不是test出来的,test是保证你的设计~~~
发表于 2012-4-27 16:08:24 | 显示全部楼层
回复 7# clean_water


    但verification的工作量非常大
发表于 2012-4-27 18:24:20 | 显示全部楼层
回复 8# edacw


    恩,是的,验证工作量的确是非常大,通常是占了整个项目一半以上的时间。
但是这和“好的设计是设计、design出来的”并不矛盾~~~
发表于 2012-4-27 21:29:36 | 显示全部楼层
Thanks.
发表于 2012-5-31 15:59:05 | 显示全部楼层
great great!
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