tmax test setup问题，百思不得其解...

shycat · 发表于 2011-11-20 19:25:44

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各位大牛，ATPG时候我这边有个初始化向量，通过jtag输入激励后，芯片才可进入测试模式，这个很多资料都有提到。
现在我的这个初始化向量里面有个loop，非常的长，其实就是等待很久，发现Tmax 不能store 这么大的一个向量在做DRC的时候，tool hung了。。这样我就不能通过GSV来debug。

请问，可以在这个时候保存test setup波形吗？另其输出一个文件。
或者是否有仿真器行为和tmax一样？因为有tmax支持的verilog语句不多。。。

先谢谢了

ln76wlguo · 发表于 2011-11-20 19:55:12

report gate 是否可以

cheernixue · 发表于 2011-11-20 19:57:16

我也是做dft的，用tmax来生产测试向量的

cheernixue · 发表于 2011-11-20 20:00:12

我是个生手，还没有好好研究过这个软件呢

shycat · 发表于 2011-11-20 21:00:09

report gate 是否可以
ln76wlguo 发表于 2011-11-20 19:55

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那我在做DFT DRC 的时候是否需要加 -store test_setup选项？如果不加的话，report gate是否可以探测到初始化向量涉及的module和reg的值以便我能够知道问题所在？

Syn2012 · 发表于 2012-11-11 11:43:03

学习了,谢谢分享!

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