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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 开源CPU设计（Risc-v,OpenMips等） › CPU设计杂谈 › 李亚民 <<cpu逻辑设计>>
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楼主: yt778899

李亚民 <<cpu逻辑设计>>

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yt778899
 楼主| 发表于 2012-8-19 15:15:46 | 显示全部楼层
自己订！！！
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airaing
发表于 2012-8-19 21:29:28 | 显示全部楼层
谢谢分享！
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airaing
发表于 2012-8-20 19:32:36 | 显示全部楼层
谢谢楼主提供资料
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ailance
发表于 2012-8-20 19:36:45 | 显示全部楼层
正寻找呢。多谢！
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yuanpin318
发表于 2012-9-4 17:55:18 | 显示全部楼层
xie xie la
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9065574912
发表于 2012-9-12 23:40:44 | 显示全部楼层
下来看看
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傅青云
发表于 2012-10-9 16:05:25 | 显示全部楼层
有没有纯verilog写的啊
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higoogle
发表于 2012-10-21 00:59:44 | 显示全部楼层
     为什么压缩 的那么碎
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servingapples
发表于 2013-2-2 14:46:25 | 显示全部楼层
学习中……谢谢分享
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bondylep
发表于 2013-4-3 15:37:35 | 显示全部楼层
正在学习中
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