error loading design怎莫解决

bonaba · 发表于 2006-11-10 14:42:33

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用modelsim仿真ise中的fft ip core 和乘法器 ip core
显示error loading design请问是为什莫？是因为没有编译必要的库吗？如果是的话，应该怎样解决呢？

libra811 · 发表于 2006-11-10 16:19:06

在load design之前要编译所有的库吧

bonaba · 发表于 2006-11-10 17:13:49

在网上查到结果，需要在post translation simulation 中运行modelsim才可以，我试过了可以成功仿真，可是无法仿真出波形，比如用乘法器，输出的乘积一直是0，请问时怎莫回事啊

hbsjzzxgssb · 发表于 2006-11-10 20:05:41

第一、你可能没有编译Xilinx库
弟二、你的testbench可能写的有问题

bonaba · 发表于 2006-11-11 19:31:59

我用的是test bench wave能说的详细点吗？乘法器这个core听简单的阿，则莫用不好呢

wice3 · 发表于 2006-11-12 22:42:38

你的testbench中，可能做了参数 generic map ，那个是不能出现的

bonaba · 发表于 2006-11-16 14:42:21

搞了很长时间，我的除了结论就是ise8.1对这个问题无能为力

haogong · 发表于 2011-6-25 21:10:06

同样的问题！

133447567 · 发表于 2012-3-28 12:45:35

我也是啊怎么办

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