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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › Analog/RF IC 设计 › Analog/RF IC 资料共享 › 用VerilogA建模PLL的资料
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楼主: woodkey

[资料] 用VerilogA建模PLL的资料

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ralphtw
发表于 2012-6-8 11:48:38 | 显示全部楼层
good of it ???
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aqishisi
发表于 2012-6-14 20:47:31 | 显示全部楼层
dddddddddddddd
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yangxiaolan1
发表于 2012-7-23 17:17:57 | 显示全部楼层
哦 呵呵谢谢了 正在学习中
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zhangrenguo
发表于 2012-7-23 17:23:34 | 显示全部楼层
不错  顶一下
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zhyfgfkd
发表于 2012-8-31 23:12:41 | 显示全部楼层
下来，看看，谢了
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yangxiaolan1
发表于 2012-11-16 16:32:51 | 显示全部楼层
能用吗 有代码吗
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hanseldsilva3
发表于 2013-1-10 03:39:57 | 显示全部楼层
良好的数据
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lupo
发表于 2013-1-10 11:45:59 | 显示全部楼层
你用VerilogA语言搭建PLL的行为级模
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langis
发表于 2013-1-10 12:09:43 | 显示全部楼层
好好来学习楼主提供的经验
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wx371793214
发表于 2013-1-10 12:09:53 | 显示全部楼层
加油加油加油加油
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