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查看: 16172|回复: 17

[原创] 大家一般是用什么软件做PLL的环路仿真的?

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发表于 2011-6-10 00:07:54 | 显示全部楼层 |阅读模式

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现在想要验证减小小数分频的PLL的spur的一点想法,需要对PLL进行整体仿真,不知道用什么软件好~
Cadence和hspice估计是不行了,根本跑不动。
老师让我用cppsim,但我试了几天以后发现这个软件算的结果不太对,现在准备用simulink,大家有什么更好的建议吗?
发表于 2011-6-10 15:20:18 | 显示全部楼层
用行为级模型代替部分模块仿真要快很多的
 楼主| 发表于 2011-6-10 15:36:17 | 显示全部楼层
回复 2# woodkey


    你是说还是用Cadence,然后用Verilog-A语言?
发表于 2011-6-10 15:39:15 | 显示全部楼层
回复 3# happygrass


   是滴,PLL仿真很耗时的嘛!我没用过Cadence之外的工具呀...
发表于 2011-6-10 15:44:43 | 显示全部楼层
本帖最后由 jeimy 于 2011-6-10 15:45 编辑

很久以前用过nanosim来仿PLL,可以对不同模块的仿真精度进行设置,所以仿真速度也还算比较快的!
发表于 2011-6-10 16:02:03 | 显示全部楼层
额 献丑啦,不懂别的tool怎么用..
发表于 2011-6-10 17:21:17 | 显示全部楼层
用VerilogA,或者simulink,做行为级仿真!!!
发表于 2011-6-11 09:45:08 | 显示全部楼层
Matlab?
 楼主| 发表于 2011-6-11 12:45:28 | 显示全部楼层
回复 5# jeimy


    学习了,我去下来试试看~
发表于 2011-6-12 21:57:29 | 显示全部楼层
Thanks.
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