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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › IC验证 › IC验证资料 › SystemVerilog、SystemC、UVM 语法高亮（gvim)
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楼主: sinva

[资料] SystemVerilog、SystemC、UVM 语法高亮（gvim)

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sinva
 楼主| 发表于 2011-6-21 19:44:25 | 显示全部楼层
回复 10# tomzhuo

很不错！emacs也行，不过就没gvim 轻巧了
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qwpsmile
发表于 2011-6-25 08:25:54 | 显示全部楼层
Good!
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gaobaitong
发表于 2011-6-25 14:51:29 | 显示全部楼层
vim很好很强大
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hustsc
发表于 2011-6-25 15:45:43 | 显示全部楼层
多谢分享
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zjcamel
发表于 2011-7-18 22:22:27 | 显示全部楼层
谢谢分享，学习了！！！
畅销就业培训课《芯片验证从入门到精通》推荐就业，赢取高薪！
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dengtyu
发表于 2011-7-21 10:58:46 | 显示全部楼层
dddddddd
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luyuan_0922
发表于 2011-7-25 12:01:04 | 显示全部楼层
还行啊
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johnsonzhxun
发表于 2011-7-27 18:16:55 | 显示全部楼层
thanks!
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qiushulin0000
发表于 2011-8-7 14:06:22 | 显示全部楼层
look look
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shujixyz
发表于 2011-8-7 14:39:15 | 显示全部楼层
谢谢。
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