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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › SOC设计论坛 › SOC资料区 › SOC平台+verilog+代码风格规范V0.4
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楼主: wmm123

[资料] SOC平台+verilog+代码风格规范V0.4

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wisehawk
发表于 2016-9-29 12:11:31 | 显示全部楼层
kk看看怎么样
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xiaojianhua
发表于 2016-9-29 12:56:42 | 显示全部楼层
谢谢分享
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mila07
发表于 2016-10-8 11:00:17 | 显示全部楼层
非常感谢
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calcap
发表于 2016-10-22 22:06:55 | 显示全部楼层
thanks
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FPGA死忠粉
发表于 2016-10-24 17:38:16 | 显示全部楼层
很有用
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snaker2015
发表于 2016-11-10 22:24:36 | 显示全部楼层
下来看看
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康酱nudt
发表于 2017-2-22 09:47:56 | 显示全部楼层
呵呵，3Q
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Desingman
发表于 2017-6-4 05:14:33 | 显示全部楼层
...............????????????????
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QQben
发表于 2018-8-21 15:41:21 | 显示全部楼层
谢谢分享
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QQben
发表于 2019-1-2 15:41:22 | 显示全部楼层
谢谢分享
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