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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › SOC设计论坛 › SOC资料区 › SOC平台+verilog+代码风格规范V0.4
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楼主: wmm123

[资料] SOC平台+verilog+代码风格规范V0.4

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knlam1001
发表于 2019-3-27 13:47:33 | 显示全部楼层
Thumbs up for you
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jackstrive
发表于 2019-3-27 14:43:12 | 显示全部楼层
Thanks.
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liufeiccccc
发表于 2019-3-28 16:46:27 | 显示全部楼层
自己总结得非常好
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cai52864
发表于 2019-4-1 22:57:10 | 显示全部楼层
謝大大分享，來學習學習SoC
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小时21
发表于 2019-4-2 15:32:19 | 显示全部楼层
谢谢
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衰神
发表于 2019-4-24 20:22:38 | 显示全部楼层
谢谢
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QQ1306
发表于 2019-4-27 12:45:34 | 显示全部楼层
顶。。。。。。。。。。。。。。。。。
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QQ1306
发表于 2019-5-1 14:30:19 | 显示全部楼层
学习。。。。。。。。。。。。。。。
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knlam1001
发表于 2019-5-3 03:22:39 | 显示全部楼层
Got it now. Thanks
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longtengniu
发表于 2019-6-23 20:47:31 | 显示全部楼层
学习一下
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