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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › IC验证 › IC验证资料 › Synopsys 《VMM for SystemVerilog》中文版
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楼主: lygany

[资料] Synopsys 《VMM for SystemVerilog》中文版

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不屈的生命
发表于 2011-9-24 10:37:03 | 显示全部楼层
thank you
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starrylight
发表于 2011-10-24 14:56:07 | 显示全部楼层
thanks for sharing
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idas643
发表于 2011-10-26 23:10:46 | 显示全部楼层
回复 1# lygany


    谢谢啊\(^o^)/~
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lioncjj
发表于 2011-11-1 00:43:35 | 显示全部楼层
不错，对SV及VMM有较为宏观的认识。
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fjdhhyg
发表于 2011-11-3 01:31:01 | 显示全部楼层
看看........................
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lzhp
发表于 2011-11-3 09:01:50 | 显示全部楼层
学习学习！！！！！！
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lzhp
发表于 2011-11-3 09:09:04 | 显示全部楼层
下不了！！！
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yuanwolf2008
发表于 2011-11-3 09:11:50 | 显示全部楼层
下来看看
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zhaowf
发表于 2011-11-4 01:04:39 | 显示全部楼层
还没看，不会是XIA老师那本吧？
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ghost_ic
发表于 2011-11-4 16:06:38 | 显示全部楼层
要疯狂的学习了！！！
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