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楼主: asyou

[资料] Verilog Designer's Library

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发表于 2013-4-9 16:43:01 | 显示全部楼层
回复 3# nieyang_eda


    jfidl;fds
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comas
发表于 2013-4-10 08:01:19 | 显示全部楼层
good job ~~~
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crablet
发表于 2013-4-10 08:07:25 | 显示全部楼层
顶下……………………
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wksim
发表于 2013-12-7 16:31:57 | 显示全部楼层
nice data. good move
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wksim
发表于 2013-12-7 16:32:40 | 显示全部楼层
回复 12# zhaodeling


    how to down? mode.
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发表于 2014-3-28 19:56:03 | 显示全部楼层
看看，谢谢
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jaitips
发表于 2014-3-28 22:47:56 | 显示全部楼层
太謝謝你了
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发表于 2014-4-15 16:03:20 | 显示全部楼层
這是好多東西呢!!!!


感謝您了~~~~
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发表于 2014-4-15 16:08:14 | 显示全部楼层
我是聽說Verilog Designer's Library是一本不錯的範例書
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发表于 2014-6-7 22:23:51 | 显示全部楼层
非常感谢
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