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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › FPGA时序设计

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楼主: qtyt

FPGA时序设计

发表于 2005-12-28 11:49:54 | 显示全部楼层

FPGA时序设计

上当了

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发表于 2006-5-14 12:22:03 | 显示全部楼层

FPGA时序设计

还好没买!

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发表于 2006-5-15 17:01:54 | 显示全部楼层

FPGA时序设计

做人要厚道！

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发表于 2006-5-19 11:23:48 | 显示全部楼层

FPGA时序设计

没有钱了呵！

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发表于 2006-5-20 17:32:46 | 显示全部楼层

FPGA时序设计

天啊，这也要钱

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发表于 2006-6-19 10:59:44 | 显示全部楼层

FPGA时序设计

贵呀

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发表于 2006-8-25 23:34:07 | 显示全部楼层

想看看，真的不好吗？

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发表于 2007-9-10 19:33:56 | 显示全部楼层

thanks!

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发表于 2007-9-11 09:43:41 | 显示全部楼层

kankan!!!!

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发表于 2007-9-11 18:37:51 | 显示全部楼层

没有钱了,mai

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