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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › Verilog三段式状态机
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楼主: stevean

[资料] Verilog三段式状态机

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天怒法师
发表于 2016-4-5 13:39:08 | 显示全部楼层
最近一直在写状态机，三段式确实比较好，顶一个
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牧2008
发表于 2016-4-6 09:30:56 | 显示全部楼层
thanks
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snaker2015
发表于 2016-10-9 19:17:20 | 显示全部楼层
看看，谢谢楼主
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dongrinba
发表于 2016-11-19 09:06:31 | 显示全部楼层
谢谢楼主的资料！
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花涛
发表于 2017-1-20 15:18:10 | 显示全部楼层
正好学习一下，谢谢楼主！
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Maccurry
发表于 2017-2-21 15:26:47 | 显示全部楼层
回复 1# stevean


   谢谢。。。。。。。。。
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Maccurry
发表于 2017-2-21 15:27:49 | 显示全部楼层
谢谢、、、、、、、、、、、、
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liaowen
发表于 2017-2-25 09:35:17 | 显示全部楼层
这个还是蛮经典的啊 哈哈
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Maccurry
发表于 2017-2-25 10:49:10 | 显示全部楼层
回复 1# stevean


   谢谢。。。。
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张绪强
发表于 2017-2-28 17:48:55 | 显示全部楼层
good, thanks.
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