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查看: 3903|回复: 8

[求助] 求教:Cadence schematic 环境设置问题 问题已解决

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发表于 2010-12-30 19:06:48 | 显示全部楼层 |阅读模式

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本帖最后由 skycloud 于 2010-12-31 12:16 编辑

绘图2.jpg

在Cadence schematic编辑环境中,添加instance,调用tsmc的pdk中的cell symbol(pmos nmos res等),schematic check后,cell symbol的pin 脚会自动显示相连的wire的名字,如net1 net2等。请问:如何设置才能去到这些wire名字的显示? 上图是示意图。
谢谢。
发表于 2010-12-31 02:00:40 | 显示全部楼层
Schematic -> Edit -> Component Display

Select Lable -> Terminal 然后选你的instance, 可以Apply To 整个库,整个同类cell,也可以是一个instance

然后你可以选择显示 pin name, net name, voltage, current, 或者什么都没有
 楼主| 发表于 2010-12-31 12:13:07 | 显示全部楼层
本帖最后由 skycloud 于 2010-12-31 12:16 编辑

回复 2# amodaman


    非常感谢,按上述方法问题解决。
发表于 2010-12-31 15:52:33 | 显示全部楼层
呵呵,看看
发表于 2011-3-28 22:51:07 | 显示全部楼层
恩,学习了!
发表于 2011-4-14 12:36:37 | 显示全部楼层
学习了
发表于 2011-4-14 20:58:26 | 显示全部楼层
学到新东西了,candence还不怎么会呢
发表于 2019-1-4 09:57:50 | 显示全部楼层
学习了,多谢分享
发表于 2019-1-5 13:50:41 | 显示全部楼层
Schematic -> Edit -> Component Display

Select Lable -> Terminal 然后选 instance
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