dc时序违规，怎么解决？

gegala

楼主一个问题两个贴，问题好像是解决，能不能总结一下？

另一个帖子及其答案：

http://bbs.eetop.cn/viewthread.p ... ;highlight=DC%2Bpad
PAD通常设成dont_touch;
看起来你的lib文件中关于上下拉的值的计算只考虑了上下拉电阻本身的因素；
你要结 ...
fly_haopp 发表于 2010-11-1 16:28

非常感谢，这个答案很正确，我跟做电路的沟通了一下，的确是可以忽略这个违规。另外从人家那了解到：
    如果是带上下拉的pad，（CMOS push-pull）输出的话，分几种情况：
1. 作为输出的时候上拉或者下拉都disable，那么相应的timing可以忽略；
2. 作为输出时上拉enable，下拉disable，那么只需要关心上拉的cell_fall timing;
3. 作为输出时下拉enable，上拉disable，那么只需要关心下拉的cell_rise timing;
4. 作为输出时上下拉都enable，design有问题！