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[求助] DCM倍频与综合所得最高频率的关系

发表于 2010-10-18 11:32:23 | 显示全部楼层 |阅读模式

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在设计中用到一个DCM模块对输入时钟进行倍频，当倍频数为2倍时，设计综合所得的最高频率是45M；可是当倍频数变为4倍时，设计综合所得的最高频率下降到22M左右了，请高手们指点一下，为什么会出现这样的状况的？若是想增大倍频倍数时，设计综合的最高频率保持不变，有可能实现的吗？要是能实现，那该如何操作的？

频率, 设计, 左右

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