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altera 同步电路的约束与时序分析

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hgp0117
发表于 2010-8-12 19:30:11 | 显示全部楼层 |阅读模式

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altera 同步电路的约束与时序分析 -----ALTERA FPGA的进阶与提高。
分析

Constraining_and_Analyzing_Timing_for_Source_Synchronous_Circuits_with_TimeQuest.pdf

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lixqing
发表于 2010-8-20 07:52:47 | 显示全部楼层
Thanks.
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greenchip
发表于 2010-8-20 08:18:40 | 显示全部楼层
非常感谢!!!
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icfans3
发表于 2010-10-20 01:39:58 | 显示全部楼层
DDDDDDDDDDDDDD
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forech
发表于 2010-12-6 15:01:45 | 显示全部楼层
谢谢~~~~
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sanylt
发表于 2010-12-6 18:10:33 | 显示全部楼层
多谢，抱走~~
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xinxinkankan
发表于 2010-12-14 19:21:31 | 显示全部楼层
不会是从HANDBOOK里截出来 的一章吧，我要的是一个流程
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nieyang000
发表于 2010-12-15 13:23:42 | 显示全部楼层
非常感谢!!!
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hqm1921
发表于 2010-12-16 13:11:06 | 显示全部楼层
赞楼主
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hqm1921
发表于 2010-12-16 13:12:55 | 显示全部楼层
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