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[原创] 请教

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发表于 2010-6-10 14:36:32 | 显示全部楼层 |阅读模式

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最近有两个问题,请高手赐教

1、FPGA编译得到的 *.pof /*.sof 是否有办法的到 *.VHD文件、*.v等输入文件 ?

2、最近用Modelsim ,逻辑用行为仿真不对数据无输出(红线),用布线后仿真输出是正确的,为何?

谢谢!
 楼主| 发表于 2010-6-10 15:02:10 | 显示全部楼层
NO body ?
发表于 2010-6-10 17:04:57 | 显示全部楼层
最好将你要请教的内容写在标题里,让人家知道你要问什么。
1. 一般来说是不行的,就算是你有手段,弄到网表,想将网表转成原先的代码,也很困难,并且是机器生成的那种,与原先相差很远。
2.你好好检查下你的代码,也许是因为部分逻辑不正确,但是工具在综合等处理后,按照一种算法转化成了电路,所以正常了。但是,不要指望工具能一定正确地明白你的意思,也许下一定它在处理时就会按另一种意思去决定。
 楼主| 发表于 2010-6-10 20:41:31 | 显示全部楼层
谢谢!我再好好看看我的代码。
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