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查看: 2874|回复: 7

[求助] FPGA设计中的一个问题

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smart0604
发表于 2010-3-22 18:36:21 | 显示全部楼层 |阅读模式

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我最近做一个数据采集处理的系统，用的是采样率为200M的AD芯片，采集后的数据输入FPGA进行FFT运算，可是FFT的时钟不能运行到200M来处理数据，我就用FIFO来缓冲数据，FIFO的一个写时钟是200M而读时钟是100M，请问在Cyclone的芯片中可以实现200M的写时钟吗？如果不行的话，有什么办法可以处理这200M的数据了？
设计, 数据采集, 芯片

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wakingbefore
发表于 2010-4-5 00:25:45 | 显示全部楼层
不知道
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stuboy
发表于 2010-4-5 03:55:40 | 显示全部楼层
如果你的FPGA不能工作的那么快，是不是可以考虑在板子上加一个单片机来控制AD，然后写到SRAM里。之后让FPGA从SRAM里面读，然后处理
在做相似的东西，大家相互探讨下
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pj123
发表于 2010-4-5 22:47:24 | 显示全部楼层
学习下。。。
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eaglelsb
发表于 2010-4-6 10:13:52 | 显示全部楼层
CYCLONE 3 勉强可以跑到200M，可以试试看，
平时我们用来跑184M
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chit_wps
发表于 2010-4-6 13:07:57 | 显示全部楼层
200M 小意思
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wodeqinshi709
发表于 2010-4-6 21:09:48 | 显示全部楼层
不懂啊
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roxhit
发表于 2010-4-6 22:35:55 | 显示全部楼层
没用过那片子，其实没必要AD采那么快吧，你就在FPGA里用100M时钟再采一次呗，100M的精确已经很高了吧
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