请教一个问题

ab23com · 发表于 2010-3-9 20:52:31

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我是一名FPGA验证工程师，平时接触到的hdl设计都是3000行左右的，且不做ASIC验证，请问我需要学习OVM或者VMM?需要学习SV吗

gaurson · 发表于 2010-3-9 22:54:34

这个看你们公司的验证平台的使用情况吧。不过如果你对这一行很感兴趣，建议学习OVM或VMM，毕竟SV是验证方向的发展趋势。

huahl · 发表于 2010-3-10 16:49:17

ovm和vmm这个就没必要了，
sv还是要了解的，毕竟时常要自己搭建一些TB

nzp1 · 发表于 2010-3-11 12:24:12

可以学习这个东东，蛮好的。 1# ab23com

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