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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › Altera FPGA CPLD设计基础篇
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楼主: hjchen01

[资料] Altera FPGA CPLD设计基础篇

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treszyy
发表于 2010-7-20 13:32:41 | 显示全部楼层
再多我也下
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treszyy
发表于 2010-7-20 15:31:50 | 显示全部楼层
希望这个不会下载到一半就下不了了
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treszyy
发表于 2010-7-20 15:33:42 | 显示全部楼层
好东西要狂顶
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treszyy
发表于 2010-7-20 15:38:32 | 显示全部楼层
这些东西要下载完一个再下另一个？？？
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treszyy
发表于 2010-7-20 15:42:48 | 显示全部楼层
好东西要顶起来
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treszyy
发表于 2010-7-20 15:45:11 | 显示全部楼层
好东西要狂顶
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treszyy
发表于 2010-7-20 15:48:05 | 显示全部楼层
好东西要狂顶
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treszyy
发表于 2010-7-20 15:49:57 | 显示全部楼层
好东西要狂顶
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treszyy
发表于 2010-7-20 15:52:14 | 显示全部楼层
好东西要狂顶
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treszyy
发表于 2010-7-20 15:54:36 | 显示全部楼层
好东西要狂顶
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