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查看: 1930|回复: 3

[资料] 用VerilogHDL描述组合逻辑电路

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nano_dv
发表于 2010-2-11 23:21:36 | 显示全部楼层 |阅读模式

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用VerilogHDL描述组合逻辑电路
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nano_dv
 楼主| 发表于 2010-2-11 23:23:09 | 显示全部楼层
是ppt格式的，希望有用
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wanyewmun
发表于 2010-2-16 19:11:07 | 显示全部楼层
太好了
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nwpuzhoukun
发表于 2010-2-19 23:26:54 | 显示全部楼层
真是好东西，谢谢楼主慷慨
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