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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › Analog/RF IC 设计 › Analog/RF IC 设计讨论 › LDO的瞬态响应上不去
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楼主: pol_sky

[求助] LDO的瞬态响应上不去

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sxb416
发表于 2010-1-14 15:48:23 | 显示全部楼层
不是吧!LDO
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jianbinma
发表于 2010-1-14 17:06:26 | 显示全部楼层
我也遇到了这个问题，我是通过加大片内电容来消除毛刺的，但是效果很有限，况且片内没有太多面积可加电容，其次我通过加大Pass管前面buffer的驱动电流来改善瞬态响应，导致整个LDO的功耗达到了900uA,不知道这个功耗是不是太大了。但似乎没有什么更好的办法了。PS：我的LDO负载是一个几十万门的数字模块，工作时钟为30MHz。
希望有高人来指点一二。
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pol_sky
 楼主| 发表于 2010-1-14 17:26:35 | 显示全部楼层
呼唤高人出现，给出正解！！！
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pipida
发表于 2010-1-14 17:30:43 | 显示全部楼层
quiescent是大了，一般就50uA以下（空载，满载效率在99%以上），可以用动态补偿方法，直接把buffer的零级点推出带宽之外，把系统整成2极点的，这样相位裕度至少有60度（一般可以搞到80度），这样瞬态响应会很不错的
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pol_sky
 楼主| 发表于 2010-1-15 10:40:42 | 显示全部楼层
quiescent是大了，一般就50uA以下（空载，满载效率在99%以上），可以用动态补偿方法，直接把buffer的零级点推出带宽之外，把系统整成2极点的，这样相位裕度至少有60度（一般可以搞到80度），这样瞬态响应会很不错的
楼上的兄弟谢谢回复，动态补偿方法怎么做，能说的具体点，这样做是把带宽做的比较大，那具体做到多少了？
盼回复！
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lrzhu
发表于 2010-1-15 12:12:57 | 显示全部楼层
15# pol_sky

logic 和 analog 电源应该分开过供吧，
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pol_sky
 楼主| 发表于 2010-1-15 15:57:00 | 显示全部楼层
ding  ding
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waley
发表于 2010-1-16 01:54:40 | 显示全部楼层
good
nice question
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glogic2k
发表于 2010-1-16 05:08:59 | 显示全部楼层
如果模拟那边没有太多的地方可以挂电容,在数字电路那边分布地多挂些小电容试试看吧,芯片空的地方都垫上
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pol_sky
 楼主| 发表于 2010-1-18 12:16:46 | 显示全部楼层
ding ding ding!
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