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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › 巨量关于FPGA的时序和时序约束资料
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楼主: hlayumi

巨量关于FPGA的时序和时序约束资料

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tiandaojin
发表于 2013-1-12 15:46:36 | 显示全部楼层
要好好学习下了1！
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zhengxianpei
发表于 2013-1-14 13:13:30 | 显示全部楼层
资料很好也很全，但是穷啊，都下下来就更穷了
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zhengxianpei
发表于 2013-1-14 13:14:46 | 显示全部楼层
楼主能否邮件啊，
zhengxianpei@163.com
谢谢啊。
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Johny_2012
发表于 2013-1-14 21:41:40 | 显示全部楼层
资料很齐全，要是打成包就好了。但是还得谢谢楼主分享~~
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hlayumi
 楼主| 发表于 2013-4-2 19:14:28 | 显示全部楼层
DDDDDDDDDD
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Asfcells
发表于 2013-4-4 03:53:18 | 显示全部楼层
剛好需要。謝謝。
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hlayumi
 楼主| 发表于 2013-7-2 13:28:58 | 显示全部楼层
反反复
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zhenli888
发表于 2013-7-15 22:48:42 | 显示全部楼层
太感谢了，学习时序
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crablet
发表于 2013-7-16 08:01:50 | 显示全部楼层
顶下…………
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john_123
发表于 2013-7-16 14:02:22 | 显示全部楼层
good sharing...
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