在线咨询
eetop公众号 创芯大讲堂 创芯人才网
切换到宽版

EETOP 创芯网论坛 (原名:电子顶级开发网)

手机号码,快捷登录

手机号码,快捷登录

找回密码

  登录   注册  

快捷导航
搜帖子
查看: 1823|回复: 0

请教Fpga和cpld在一个板子上的问题

[复制链接]
发表于 2009-10-24 09:31:16 | 显示全部楼层 |阅读模式

马上注册,结交更多好友,享用更多功能,让你轻松玩转社区。

您需要 登录 才可以下载或查看,没有账号?注册

x
现在在画一个电路板,上面fpga和cpld是在一个板子上的,我想问下,配置的时候把这两个芯片应该是用JTAG链连一起下载数据吧。之后如果要分配管脚,就是某些管脚用fpga的,某些用cpld的,这个是怎么实现呢?还有时钟输入也需要分成2股分别连fpga和cpld实现同步吗?我下了一个ML401的开发板,上面有fpga和cpld的电路连接图,但是我不知道上面把fpga的管脚,如prog_b,init_b这些跟cpld的管脚也连在一起了,这是什么作用呢?请问有没相关方面的资料或者教程?谢谢了
您需要登录后才可以回帖 登录 | 注册

本版积分规则

关闭

站长推荐 上一条 /2 下一条


小黑屋| 手机版| 关于我们| 联系我们| 在线咨询| 隐私声明| EETOP 创芯网
( 京ICP备:10050787号 京公网安备:11010502037710 )

GMT+8, 2024-11-23 00:44 , Processed in 0.012471 second(s), 6 queries , Gzip On, Redis On.

eetop公众号 创芯大讲堂 创芯人才网
快速回复 返回顶部 返回列表