急求解答cross-module reference resolution error

yurenjie · 发表于 2009-10-15 21:01:39

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VCS后仿真，编译时出错
“cross-module reference resolution error”
怎么回事啊！耗很长时间了----
求救啊！！

伊露凌 · 发表于 2009-10-21 15:09:29

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zeushuang · 发表于 2013-2-5 11:27:11

你再细心一点，就发现这个错误是很简单的错误。
所报路径的hierarchy中没有此信号。

小玉儿 · 发表于 2013-2-5 22:04:44

这个很可能在class的类的作用域符号导致错误，还有在例化的引用方面没有正确处理，这往往最容易造成笔误的错误奥。。

momoi11 · 发表于 2016-4-14 11:49:19

楼主我也报这个错，后来发现是语法错误，我把interface里的输入输出信号名字少写了一点

hu30454293 · 发表于 2016-9-13 11:44:09

回复 5# momoi11

所有的interface都需要在vlogan进行编译吗？

我现在也报这个错误，代码看了很久，没发现语法问题。。

樱雨霏霏 · 发表于 2017-3-28 14:50:50

同问，也遇上这个问题了

太阳公子 · 发表于 2017-3-28 15:57:53

一般都是例化或者信号引用的hierarchy错误

uestc_zyd · 发表于 2018-6-9 16:06:49

在SoC验证上，大家一起协作维护一套环境，当某个人在总环境中加了一个点到module里面的信号，而刚好你把这个modue放空了，真是很难想到是这个错误啊。。。

qwe2508 · 发表于 2019-6-12 14:56:03

这种错误往往就是你的命令输错了，比如你实例化的句柄是tr，你输成了tf，最快的办法就是将给出的提示（一般会用双引号提示出来）进行搜索，你会发现很低级的错误

伊露凌伊露凌当前离线积分 180 头像被屏蔽	发表于 2009-10-21 15:09:29 \| 显示全部楼层提示: 作者被禁止或删除内容自动屏蔽
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