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verilog test bench 入门

发表于 2009-10-6 15:49:05 | 显示全部楼层 |阅读模式

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介绍了verilog HDL test bench的知识，其实代码的测试时非常繁杂和重要的

Verilog HDL Test Bench入门.pdf

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发表于 2009-10-6 16:31:18 | 显示全部楼层

goooooooooooooood

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发表于 2009-10-7 10:15:04 | 显示全部楼层

this is a nice document .

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发表于 2009-10-7 13:55:15 | 显示全部楼层

hope it really nice

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发表于 2009-10-7 14:59:05 | 显示全部楼层

hope it really nice

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发表于 2009-10-7 16:08:50 | 显示全部楼层

ok thanks

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发表于 2009-10-7 19:35:05 | 显示全部楼层

正需要，谢谢

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发表于 2009-10-7 20:54:54 | 显示全部楼层

好东西啊。。。哈哈。。

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发表于 2009-10-9 13:14:26 | 显示全部楼层

thanks thanks

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发表于 2009-10-9 13:56:24 | 显示全部楼层

thanks

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