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锁相环不能够时序仿真?

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发表于 2009-8-6 18:05:57 | 显示全部楼层 |阅读模式

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我用FPGA板子EP2C8做数字滤波器仿真时用功能仿真的话能够得到结果,如果改为时序仿真锁相环就没有信号输出了,是不是锁相环不能够用时序仿真?请大家帮忙
发表于 2009-8-6 18:15:17 | 显示全部楼层
为了下载,顶啊
发表于 2009-8-6 18:36:20 | 显示全部楼层
接着顶
发表于 2009-8-6 18:43:25 | 显示全部楼层
接着顶啊
发表于 2009-8-6 18:55:38 | 显示全部楼层
应该可以吧!!!不过没有试过!
 楼主| 发表于 2009-8-6 22:13:06 | 显示全部楼层
前面说锁相环在时序的仿真情况下没有信号输出。
我总结了下原因可能是:锁相环设置输入信号clk是50M,输出是10M。而当执行时序仿真的时候我取的clk信号为100M,造成了与锁相环设置的冲突,所以不能够产生输出信号。
发表于 2009-8-7 14:15:49 | 显示全部楼层
帮顶~
发表于 2009-8-14 15:48:15 | 显示全部楼层
呵呵,学习学习
头像被屏蔽
发表于 2009-8-14 19:35:56 | 显示全部楼层
提示: 作者被禁止或删除 内容自动屏蔽
发表于 2009-8-17 18:14:05 | 显示全部楼层
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