Cadence DAC 2008 时序模型的文章

jediai · 发表于 2009-7-9 00:17:03

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Challenges in Gate Level Modeling for Delay and SI at 65nm and Below
有关时序模型方面的大牛文章，从Drive model（Voltage-Response Models/Non-Linear Delay Model/Current-Source models）和Receive model两方面介绍了未来时序建模的趋势，读过后会对CCS ECSM模型及未来时序建模的发展有一定的了解
有兴趣的就下咯