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CMOS开关中N管的宽长比一般取多大

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发表于 2009-4-22 19:56:51 | 显示全部楼层 |阅读模式

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现在在做采样保持电路,但是不知道CMOS开关中N管W/L比取10还是其他数值,比如0.18UM工艺,N管 1.8um/0.18,这样W/L比是10,望做过的朋友告知,谢谢!

[ 本帖最后由 sunery 于 2009-4-27 13:57 编辑 ]
发表于 2009-4-23 16:16:24 | 显示全部楼层
这个要看实际情况吧
开关管子尺寸越大,寄生电容越大,clock feedthrough越大,对输出电压的影响越大。
尺寸越小,导通电阻越大,造成开关两端的电压差越大。
头像被屏蔽
发表于 2009-4-23 17:36:50 | 显示全部楼层
提示: 作者被禁止或删除 内容自动屏蔽
发表于 2009-4-25 02:33:49 | 显示全部楼层


原帖由 peterlin2009 于 2009-4-23 17:36 发表
sample AND hold  一般 nmos 當 switch 除 W/L 還得考慮 幾個  Rds_on , charge_injection   ..一般 使用 dummy mos 降低 switch 瞬間 charge 問題  而 rds on 可拉大 W  方式  ..不過 還有個問題 是比較少討論 如果 ...



0.18的leakage current 基本上很小,速度用bootstrap network改善嘛
发表于 2009-4-25 10:38:14 | 显示全部楼层
trade off between settling time and clock feedthrough

simulate
 楼主| 发表于 2009-4-27 21:06:32 | 显示全部楼层
谢谢各位了,有点懂了
发表于 2009-4-29 15:40:14 | 显示全部楼层
要给根据实际情况,折中
发表于 2009-4-29 19:43:52 | 显示全部楼层
要看你設計的實際情形,大或小都有他的好處壞處
发表于 2009-4-29 19:59:27 | 显示全部楼层
具体电路的宽长比都是要经过计算得出的
发表于 2009-7-6 16:16:38 | 显示全部楼层
怎么知道所采样的cmos开关的导通电阻???
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