Synplicity.Synplify.Premier.v9.6.2

andyhere2009 · 发表于 2009-4-21 21:39:44

好像只能用VHDL仿真，不支持VERILOG

andyhere2009 · 发表于 2009-4-21 21:41:47

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andyhere2009 · 发表于 2009-4-21 21:43:12

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andyhere2009 · 发表于 2009-4-21 21:44:16

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andyhere2009 · 发表于 2009-4-21 21:45:20

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andyhere2009 · 发表于 2009-4-21 21:47:24

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andyhere2009 · 发表于 2009-4-21 21:48:51

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andyhere2009 · 发表于 2009-4-21 21:50:56

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andyhere2009 · 发表于 2009-4-21 21:52:13

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andyhere2009 · 发表于 2009-4-21 21:54:21

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