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楼主: wapoca

CRC16verilog 算法

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jpwdtw
发表于 2019-3-8 15:41:50 | 显示全部楼层
感谢楼主分享！
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shancjb
发表于 2019-3-8 19:15:37 | 显示全部楼层
dingiexian
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郑模艳
发表于 2019-6-18 09:00:10 | 显示全部楼层
请问这个CRC的电路怎么生成的，为什么在第1，5，12，16个寄存器那里有一个异或门？对于通信协议懂了，就是硬件电路没有看懂，希望楼主可以解答一下。
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甲壳虫
发表于 2019-8-8 11:54:57 | 显示全部楼层
顶一下，
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zzq81
发表于 2019-8-8 22:50:56 | 显示全部楼层
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nitheshbk
发表于 2019-8-9 11:40:27 | 显示全部楼层
thank you
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甲壳虫
发表于 2019-8-10 09:43:10 | 显示全部楼层
正好学习学习。
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Raininheaven
发表于 2019-10-30 09:51:52 | 显示全部楼层
very good
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gouyaer123
发表于 2019-10-30 10:37:53 | 显示全部楼层
i get it ok how nice
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xiaofuss_
发表于 2019-10-30 11:05:43 | 显示全部楼层
thank you I like it nice
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