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Verilog Coding for Logic Synthesis

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发表于 2009-1-6 08:57:16 | 显示全部楼层 |阅读模式

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Verilog Coding for Logic Synthesis.rar

954.3 KB, 下载次数: 67 , 下载积分: 资产 -2 信元, 下载支出 2 信元

发表于 2009-1-6 08:59:39 | 显示全部楼层
:handshake
发表于 2009-1-6 16:11:16 | 显示全部楼层
谢谢楼主
发表于 2009-2-3 05:10:05 | 显示全部楼层
Thanks for sharing
发表于 2009-2-17 16:44:16 | 显示全部楼层

谢谢lz
发表于 2009-2-17 16:47:18 | 显示全部楼层
正想要这方面的资料,谢谢楼主分享
发表于 2009-6-16 08:09:49 | 显示全部楼层
good, thanks
发表于 2011-6-19 22:43:30 | 显示全部楼层
very good analog courceware

thanks for share!
发表于 2011-6-20 10:40:13 | 显示全部楼层
谢谢分享
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