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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › IC验证 › IC验证资料 › VMM for SystemVerilog中文版
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楼主: hemm2000

VMM for SystemVerilog中文版

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发表于 2009-5-13 21:09:33 | 显示全部楼层
好书谢谢
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发表于 2009-5-31 11:01:14 | 显示全部楼层
好书 谢谢d
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kylkzy
发表于 2009-6-11 21:32:16 | 显示全部楼层
:lol :lol
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yxxwgs
发表于 2009-6-22 15:03:02 | 显示全部楼层
真是非常感谢分享啊！
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发表于 2009-6-22 15:20:51 | 显示全部楼层

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发表于 2009-6-22 15:36:50 | 显示全部楼层

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lgechao
发表于 2009-8-5 09:32:11 | 显示全部楼层
thanks!
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发表于 2009-8-5 23:21:22 | 显示全部楼层
SystemVerilog应用手册
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发表于 2009-8-5 23:23:14 | 显示全部楼层
SystemVerilog应用手册87
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发表于 2009-8-9 18:26:55 | 显示全部楼层

看看怎么样，顺带灌水

灌水为下资料啊
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