AHB中顶层模块怎样写

silenthawk · 发表于 2008-5-20 11:32:41

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我在做一个AHB总线控制器，每个子模块(包括arbiter,decoder,muxs2m,muxm2s,master,slave)基本都完成了，现在要把这些模块都写到顶层模块中，有一些疑问麻烦大家指导一下：
1.如果A模块的输出信号A1,A2,A3是B模块的输入，那么是不是A1,A2,A3都要声明为wire型呢，如果不是的话那么哪些信号要声明为wire型；

2.在A和B各自的模块中，B中输入信号B1，B2，B3是不是一定要和从A输入进来的A1,A2,A3信号名字一样呢？

谢谢！

dmq0420 · 发表于 2008-5-23 09:16:03

1. 两个模块之间的连线最好显式声明称wire
2. 信号名不一定要一样，随便即可。不过信号名一致便于阅读

maomao78612 · 发表于 2008-5-24 03:33:23

楼主说得太好了，强烈支持。我帮你顶起来。!!

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daisyniu · 发表于 2010-4-7 16:27:00

学习了

lhb · 发表于 2010-5-5 11:32:29

学习学习

redleaf1988 · 发表于 2015-4-10 20:05:26

顶楼上

AHB中顶层模块怎样写

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