systemverilog_教程

kevinwjs · 发表于 2008-4-7 11:14:34

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*    Verification Concepts and Technologies
*    SystemVerilog Basics
*    Functional Coverage Random Constraints, Coverage
*    Assertions
*    Stimulus and Response
*    Architecting Testbenches
*    Verification Plan and Management.

lufeng21cn · 发表于 2008-4-7 14:56:26

不知道怎么样啊，看看

gnc · 发表于 2008-4-7 17:10:30

现在SV使用得越来越多了吗？想学学看

liutingting117 · 发表于 2008-4-7 17:29:51

顶楼主，谢谢

liutingting117 · 发表于 2008-4-7 17:30:56

顶楼主，谢谢

liutingting117 · 发表于 2008-4-7 17:32:00

顶楼主，谢谢

liutingting117 · 发表于 2008-4-7 17:32:58

ding ding ding ,xie xie

armmips · 发表于 2008-4-17 02:00:28

Thanks for your sharing

armmips · 发表于 2008-4-17 02:04:24

Thanks for your sharing

aprice · 发表于 2008-5-14 10:05:25

看一下，学习

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