通过Cadence中的Eye Diagram眼图仿真可以看设计的PLL的时钟抖动吗？

220194952 · 发表于 2020-7-14 22:20:01

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本人设计了一个压控振荡器，输出频率1.016GHz，周期984.25ps。

在开环状态下进行Eye Diagram眼图仿真，取Eye Period=984ps，结果如下：

取Eye Period=984.1ps，结果如下：

取Eye Period=984.08ps，结果如下：

显然Eye Period取不同的值所显示出的“抖动”是不同的，而且好像并不是越靠近真实时钟周期“抖动”越小。
请问是怎么看时钟抖动的呢？所谓的抖动是随着Eye Period一直在变的啊

Keduoli · 发表于 2025-5-19 15:58:28

stm2010 发表于 2025-5-15 15:02
亲测有效

请问下用这种方法得到眼图后，该怎么看jitter的大小呢？

stm2010 · 发表于 2025-5-15 15:02:05

zhwchaser 发表于 2020-7-21 12:25
首先，不准确的讲，VCO的频率是无法精确测出来的，因为不是固定频率Fref * N这种形式；
VCO应该只能测出来p ...

亲测有效

illusion159357 · 发表于 2025-5-7 09:06:40

zhwchaser 发表于 2020-7-21 12:25
首先，不准确的讲，VCO的频率是无法精确测出来的，因为不是固定频率Fref * N这种形式；
VCO应该只能测出来p ...

大佬，按你的方法做了，这眼图看上去似乎是N个周期在power/2出的叠加，在power/2处的时候最窄，然后在两侧逐渐变宽，这时候看jitter怎么看呢？是看最窄处的宽度吗？

K1rost · 发表于 2025-4-21 09:31:47

学习了，mark一下！

zhwchaser · 发表于 2024-12-24 15:04:10

菜菜CC 发表于 2023-10-10 22:12
这个这个眼图算出来的是什么Jitter呢？RMS Jitter还是PkP?

peak to peak

zhwchaser · 发表于 2024-12-24 15:03:18

吃花椒的喵酱发表于 2024-11-6 11:25
正解！帮忙了！另外，三种cross type分别代表什么含义呢？

如果是看开环的clock的period jitter/1 cycle jitter，那么就选external(edge)，然后signal选择你想要plot的clock信号就行了；这种方法你可以理解为用CDR的方式来把clock lock住；

吃花椒的喵酱 · 发表于 2024-11-6 11:25:33

zhwchaser 发表于 2020-7-21 12:25
首先，不准确的讲，VCO的频率是无法精确测出来的，因为不是固定频率Fref * N这种形式；
VCO应该只能测出来p ...

正解！帮忙了！另外，三种cross type分别代表什么含义呢？

yangleiqiang · 发表于 2024-9-25 16:07:43

确实会一直变，频率抖动是瞬时概念，你逐步改变周期值，眼图的抖动会由粗变细再变粗，最细的时候就是眼图实验观测到的平均周期值，抖动积累就那个值，而且观测周期越多越粗

zhengzih · 发表于 2024-9-25 14:10:56

学到了，mark一下

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